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embedded_systems:zynq7000:mapping_flink1 [2020-12-09 09:47] – Urs Graf | embedded_systems:zynq7000:mapping_flink1 [2021-03-08 18:44] – Urs Graf | ||
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====== Pin Mapping for flink1 Configuration ====== | ====== Pin Mapping for flink1 Configuration ====== | ||
^FPGA pin^flink device^channel number^FPGA pin^flink device^channel number^FPGA pin^flink device^channel number^ | ^FPGA pin^flink device^channel number^FPGA pin^flink device^channel number^FPGA pin^flink device^channel number^ | ||
- | |B19|gpio|0|G20|gpio|30|V20|gpio|60| | + | |B19|gpio|0|H15|gpio|33|W15|gpio|66| |
- | |B20|:::|1|H20|:::|31|U20|:::|61| | + | |B20|:::|1|J14|:::|34|U14|:::|67| |
- | |A20|:::|2|K14|:::|32|W20|:::|62| | + | |A20|:::|2|G15|:::|35|U18|:::|68| |
- | |E17|:::|3|H15|:::|33|Y18|:::|63| | + | |E17|:::|3|N15|:::|36|U15|:::|69| |
- | |D19|:::|4|J14|:::|34|V16|:::|64| | + | |D19|:::|4|L14|:::|37|U19|:::|70| |
- | |D18|:::|5|G15|:::|35|U17|:::|65| | + | |D18|:::|5|N16|:::|38|N18|:::|71| |
- | |E19|:::|6|N15|:::|36|W15|:::|66| | + | |E19|:::|6|L15|:::|39|N20|:::|72| |
- | |F17|:::|7|L14|:::|37|U14|:::|67| | + | |F17|:::|7|M14|:::|40|T15|:::|73| |
- | |L19|:::|8|N16|:::|38|U18|:::|68| | + | |L19|:::|8|K16|:::|41|R14|:::|74| |
- | |M19|:::|9|L15|:::|39|U15|:::|69| | + | |M19|:::|9|M15|:::|42|Y16|:::|75| |
- | |L20|::: | + | |L20|::: |
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- | |M17|::: | + | |M17|::: |
- | |K19|::: | + | |K19|::: |
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- | |G19|::: | + | |G19|::: |
- | |J20|::: | + | |J20|::: |
- | + | |G20|::: | |
+ | |H20|::: | ||
+ | |K14|::: |