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software:linux:fpga_loader [2020-03-18 15:52] grafsoftware:linux:fpga_loader [2020-03-18 16:39] graf
Zeile 19: Zeile 19:
 # dd if=design.rbf of=/dev/fpga_loader bs=5M # dd if=design.rbf of=/dev/fpga_loader bs=5M
 </code> </code>
 +
 +===== Details =====
 +[[https://www.intel.com/content/dam/www/programmable/us/en/pdfs/literature/hb/cyclone-iv/cyiv-51008.pdf]] shows how the FPGA is configured properly. 
 +The timing is as follows {{ :software:linux:timing.pdf |}}. Please note that //Two DCLK falling edges are required after CONF_DONE goes high to begin the
 +initialization of the device.//
 +
 +